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- Verilog
- VHDL
- Xilinx
- Altera
- 时序
1.根据项目需求,分析实现方案,并完成FPGA选型、方案设计及编写;
2.分配FPGA开发任务,组织、协调、指导FPGA工程师完成开发、仿真、调试工作;
3.负责组织、指导FPGA工程师提交技术文档、设计文件,并审核整理后归档;
4.组织、指导FPGA工程师定位并解决问题;
5.参与或主导FPGA疑难问题的定位、解决;
6.制定部门开发流程,规范部门行为,建立部门文档体系;
7.培训初、中级FPGA开发工程师,提升团队技术实力。
岗位要求:
1.统招本科及以上学历,5年以上相关工作经验;
2.熟练使用Xilinx或Altera芯片开发环境,熟悉综合仿真软件及调试工具;
3.熟练使用FPGA片上资源,可根据需求进行资源优化、性能优化;
4.精通 VerilogHDL或VHDL语言等硬件描述语言;
5.精通FPGA时序约束、时序分析、时序优化方法;
6.掌握FFGA设计、开发流程,具有独立的FPGA开发、调试、解决疑难问题能力;
7.有SRIO(Serial RapidIO)、PCIE、AURORA、DDR3、LBE开发经验优先;
8.有Soc架构FFGA/ASIC设计经验,掌握AXI总线协议者优先;
9.具备良好的沟通能力,有过管理经验者优先。
认证资质
李先生
竞争力分析
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更新于:2024-06-13